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μ PD44646092A-A, 44646182A-A, 44646362A-A, 44646093A-A, 44646183A-A, 44646363A-A
DC Characteristics (T A = 0 to 70°C, V DD = 1.8 ± 0.1 V)
Parameter
Symbol
Test condition
MIN.
MAX.
Unit
Note
x9
x18
x36
Input leakage current
I/O leakage current
I LI
I LO
–2
–2
+2
+2
μ A
μ A
4, 5
4
Operating supply current
(Read cycle / Write cycle)
I DD
V IN ≤ V IL or V IN ≥ V IH
I I/O = 0 mA
-E20
-E22
Note1
Note1
690
650
740
695
850
790
mA
Cycle = MAX.
-E25
-E30
-E33
610
530
490
650
590
560
730
670
640
Standby supply current
(NOP)
I SB1
V IN ≤ V IL or V IN ≥ V IH
I I/O = 0 mA
-E20
-E22
Note1
Note1
440
430
470
450
530
505
mA
Cycle = MAX.
Inputs static
-E25
-E30
-E33
410
380
370
430
400
390
480
450
430
Output HIGH voltage
Output LOW voltage
V OH(Low)
V OH
V OL(Low)
V OL
|I OH | ≤ 0.1 mA
Note2
I OL ≤ 0.1 mA
Note3
V DD Q – 0.2
V DD Q/2–0.12
V SS
V DD Q/2–0.12
V DD Q
V DD Q/2+0.12
0.2
V DD Q/2+0.12
V
V
6, 7
6, 7
6, 7
6, 7
Notes 1. -E20 and -E22 are valid for 2.5 Clock Cycles Read Latency products.
2. Outputs are impedance-controlled. | I OH | = (V DD Q/2)/(RQ/5) ±15% for values of 175 ? ≤ RQ ≤ 350 ? .
3. Outputs are impedance-controlled. I OL = (V DD Q/2)/(RQ/5) ±15% for values of 175 ? ≤ RQ ≤ 350 ? .
4. Measured with ODT off.
5. ODT pin is internally tied to V SS , so input leakage current value is ±5 μ A.
6. AC load current is higher than the shown DC values.
7. HSTL outputs meet JEDEC HSTL Class I standards.
Capacitance (T A = 25 ° C, f = 1 MHz)
Parameter
Input capacitance (Address, Control)
Input / Output capacitance
Symbol
C IN
C I/O
Test conditions
V IN = 0 V
V I/O = 0 V
MIN.
MAX.
4
5
Unit
pF
pF
(DQ, CQ, CQ#, QVLD)
Clock Input capacitance
C clk
V clk = 0 V
4
pF
Remark These parameters are periodically sampled and not 100% tested.
Data Sheet M19960EJ2V0DS
15
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